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[Arm프로세서] 멀티 레벨 캐시 Arm: Cache and Barrier

캐시의 구조와 기본 동작 원리를 숙지하면 "프로세서 내부에 CPU 근처에 캐시가 하나가 있겠구나"라고 여깁니다. 하지만 Arm 프로세서를 비롯한 대부분 프로세서는 멀티 레벨로 캐시를 구성합니다. Arm 아키텍처 문서를 보면 실제 캐시는 L1 캐시로 혹은 L2 캐시로 구성돼 있다는 사실을 알게 됩니다. 캐시의 동작 원리를 제대로 파악하려면 멀티 레벨 캐시가 어떤 방식으로 구성됐는지 알 필요가 있습니다. 

캐시를 레벨로 구성하는 이유를 알아보고 L1 캐시 L2 캐시에 대해 살펴보겠습니다.


#Reference Armv8: 캐시(Cache)

캐시 소개
캐시의 기본 동작 원리
   캐시의 검색 방법
   캐시 lookup 기본 동작 원리
       캐시 히트 동작  
       캐시 미스 동작  
캐시 제어 레지스터

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